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来源：蜘蛛抓取(WebSpider) 时间：2014-06-20 13:28 标签： 小山田耕太
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基于ISE Foundation的逻辑设计 - Xilinx FPGA开发实用教程（第2版）-徐文波、田耘
来源：电子发烧友网
作者：灰色天空日 16:20
[导读] 第4章基于ISE Foundation的逻辑设计 4.1ISE套件 4.1.1ISE的特点 4.1.2ISE的功能 4.1.3ISE的安装 4.1.4ISE的用户界面 4.2基于ISE的设计输入 4.2.1新建工程 4.2.2代码输入 4.2
第4章基于ISE Foundation的逻辑设计
　　4.1ISE套件
　　4.1.1ISE的特点
　　4.1.2ISE的功能
　　4.1.3ISE的安装
　　4.1.4ISE的用户界面
　　4.2基于ISE的设计输入
　　4.2.1新建工程
　　4.2.2代码输入
　　4.2.3代码模板的使用
　　4.2.4Xilinx IP Core的原理与应用
　　4.3ISE基本操作
　　4.3.1基于Xilinx XST的综合
　　4.3.2基于ISim的仿真
　　4.3.3基于ISE的实现
　　4.3.4基于目标和策略的设计方法
　　4.3.5基于SmartGuide的设计方法
　　4.3.6比特文件的生成
　　4.3.7基于IMPACT的芯片配置
　　4.3.8功耗分析以及XPower的使用
　　4.4约束
　　4.4.1约束文件
　　4.4.2UCF文件的语法说明
　　4.4.3引脚和区域约束语法
　　4.4.4时序约束语法
　　4.5调试利器&&ChipScope Pro
　　4.5.1ChipScope Pro工作原理
　　4.5.2ChipScope Pro操作流程
　　4.5.3ChipScope Pro开发实例
　　4.6ISE与第三方EDA软件
　　4.6.1ModelSim软件的使用
　　4.6.2ModelSim和ISE的联合开发流程
　　4.6.3MATLAB软件的使用
　　4.6.4ISE与MATLAB的联合使用
　　4.6.5MATLAB、ModelSim和ISE联合开发实例
　　本章小结
　　第5章时序分析
　　5.1时序分析的作用和原理
　　5.1.1时序分析的作用
　　5.1.2静态时序分析原理
　　5.1.3时序分析的基础知识
　　5.2Xilinx FPGA中的时钟资源
　　5.2.1全局时钟资源
　　5.2.2第二全局时钟资源
　　5.3ISE时序分析器
　　5.3.1时序分析器的特点
　　5.3.2时序分析器的文件类型
　　5.3.3时序分析器的调用与用户界面
　　5.3.4提高时序性能的手段
　　本章小结
　　第6章逻辑开发专题
　　6.1Verilog HDL设计进阶
　　6.1.1面向硬件的程序设计思维
　　6.1.2&面积&和&速度&的转换原则
　　6.1.3同步电路的设计原则
　　6.2Xilinx FPGA芯片底层单元的使用
　　6.2.1Xilinx全局时钟网络的使用
　　6.2.2CMT时钟管理模块的使用
　　6.2.3Xilinx内嵌块存储器的使用
　　6.2.4硬核乘加器的使用
　　6.3代码风格
　　6.3.1代码风格的含义
　　6.3.2代码书写风格
　　6.3.3通用设计代码风格
　　6.3.4Xilinx专用设计代码风格
　　6.4UART接口开发实例
　　6.4.1串口接口与RS?232协议
　　6.4.2串口通信控制器的Verilog HDL实现
　　6.4.3RS?232设计板级调试
　　本章小结
　　第7章基于EDK的嵌入式系统设计
　　7.1可配置嵌入式系统(EDK)
　　7.1.1基于FPGA的可编程嵌入式开发系统
　　7.1.2Xilinx公司的解决方案
　　7.2Xilinx嵌入式开发系统组成
　　7.2.1片内微处理器软核MicroBlaze
　　7.2.2PLB总线系统结构
　　7.2.3IP核以及设备驱动
　　7.3EDK软件
　　7.3.1EDK设计的实现流程
　　7.3.2EDK的文件管理架构
　　7.4XPS软件典型操作
　　7.4.1XPS的启动
　　7.4.2利用BSB创建新工程
　　7.4.3XPS的用户界面
　　7.4.4XPS的目录结构与硬件平台
　　7.4.5在XPS加入IP Core
　　7.4.6XPS工程的综合与实现
　　7.5SDK软件典型操作
　　7.5.1SDK的用户界面
　　7.5.2SDK的典型操作
　　7.5.3IP外设的API函数查阅和使用方法
　　7.5.4GPIO外设开发实例
　　7.5.5其他外设开发实例
　　本章小结
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